VLSI architectures for iterative decoding of concatenated codes with interleavers / Masera, Guido; Montorsi, Guido; G., Piccinini; RUO ROCH, Massimo; Zamboni, Maurizio. - (1997), pp. 408-413. (Intervento presentato al convegno 4TH EUROPEAN CONFERENCE ON SATELLITE COMMUNICATIONS).

VLSI architectures for iterative decoding of concatenated codes with interleavers

MASERA, Guido;MONTORSI, Guido;RUO ROCH, Massimo;ZAMBONI, Maurizio
1997

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Utilizza questo identificativo per citare o creare un link a questo documento: https://hdl.handle.net/11583/1414696
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