Archivio Istituzionale della RicercaA time-slice based scheduler model for System Level Design / V., Shah; Passerone, Claudio; Lavagno, Luciano; Y., Watanabe. - (2005), pp. 378-383. (Intervento presentato al convegno IEEE Design, Automation and Test in Europe nel March 7-11).
A time-slice based scheduler model for System Level Design
PASSERONE, Claudio;LAVAGNO, Luciano;
2005
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https://hdl.handle.net/11583/1416423
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