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Reducing the computation time in (short bit-width) two's complement multipliers

Tipo di pubblicazione: Articolo su rivista
Tipologia MIUR: Contributo su Rivista > Articolo in rivista
Titolo: Reducing the computation time in (short bit-width) two's complement multipliers
Autori: Lamberti F.; Andrikos N; Antelo E; Montuschi P
Autori di ateneo:
Titolo del periodico: IEEE TRANSACTIONS ON COMPUTERS
Tipo di referee: Tipo non specificato
Volume: 60:2
Intervallo pagine: pp. 148-156
Numero di pagine: 9
ISSN: 0018-9340
Data: 2011
Status: Pubblicato
Lingua della pubblicazione: Inglese
Parole chiave:
Dipartimenti (originale): DAUIN - Dipartimento di Automatica Informatica
Dipartimenti: DAUIN - Dipartimento di Automatica e Informatica
URL correlate:
    Area disciplinare: Area 09 - Ingegneria industriale e dell'informazione > SISTEMI DI ELABORAZIONE DELLE INFORMAZIONI
    Data di deposito: 13 Mag 2010 22:58
    Data ultima modifica (IRIS): 09 Mag 2016 14:26:24
    Data inserimento (PORTO): 11 Mag 2016 03:52
    Numero Identificativo (DOI): 10.1109/TC.2010.156
    Permalink: http://porto.polito.it/id/eprint/2354528
    Link resolver URL: Link resolver link
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